《西门子Veloce CS硬件仿真系统获Arm采用 加速Neoverse平台验证流程》

  • 来源专题:新一代信息技术
  • 编译者: 张嘉璐
  • 发布时间:2025-07-30
  • 作为Veloce平台的长期用户,Arm现采用Veloce CS硬件仿真系统作为其Neoverse计算子系统(CSS)设计流程的关键环节。"在当今计算时代,上市周期正成为合作伙伴生态的核心关注点,也是保持竞争力的关键,"Arm生产力工程负责人Karima Dridi表示,"Arm Neoverse CSS的核心价值在于通过采用西门子Veloce CS等创新工具实现的预验证能力,助力合作伙伴加速芯片解决方案上市。"

    西门子数字化工业软件硬件辅助验证业务副总裁Jean-Marie Brunet详解技术优势:"搭载Veloce PCIe复合设备的Veloce Strato CS提供卓越的仿真性能提升与独特的可扩展容量,而基于AMD VP1902自适应SoC的Veloce proFPGA CS则提供快速可扩展的原型设计解决方案。Veloce CS系统能全面应对硬件、软件及系统工程师面临的多样化挑战,我们与Arm的长期合作为精准把握其需求变化奠定了坚实基础。"

    Veloce CS系统采用模块化刀片式架构,符合现代数据中心对简易安装、超低功耗、高效散热及紧凑占地的严苛要求。Veloce proFPGA CS另提供桌面实验室版本以增强用户灵活性。具体技术优势包括:

    ? Veloce Strato CS:支持4000万门至400亿门级设计规模在保持高速全可视调试能力同时实现高性能仿真通过PCIe复合设备(PCD)技术集成Arm合规套件(ACS)、PCIe与NVMe协议在Veloce协议分析器支持下提供统一系统可视化调试环境? Veloce proFPGA CS:从单FPGA(VP1902)到数百FPGA的弹性扩展高性能模块化设计显著加速:

    ? 固件开发

    ? 操作系统移植

    ? 应用程序优化

    ? 系统集成验证


  • 原文来源:https://www.newelectronics.co.uk/content/news/siemens-veloce-cs-selected-by-arm-for-neoverse-verification-and-validation
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    • Moortec宣布将其TSMC 7nm FinFET制程上的芯片内监控解决方案提供给新的Arm®(安谋)Neoverse™ N1系统开发平台(SDP)。 作为市场领导者的Moortec乐意将其工艺、电压和温度(PVT)传感子系统技术集成和利用到该平台,从而实现由Arm Neoverse解决方案提供动力支持的新一代云端到边缘基础架构。Neoverse N1 SDP是业界首个7nm基础架构专用系统开发平台,可以通过CCIX互连架构实现非对称计算加速。Moortec和Arm之间的合作创造了一个能够动态感知芯片内状况的解决方案,如此可帮助减少功耗,最大程度优化系统速度并提高设备可靠性。Neoverse N1 SDP能够被硬件和软件开发商用来进行硬件原型设计、软件开发、系统验证、性能分析/调整。 Arm基础设施业务营销副总裁Mohamed Awad表示:“Arm Neoverse解决方案旨在为世界提供云端到边缘基础设施所需的性能和效率。我们与Moortec在N1 SDP测试芯片上的合作展示了IP在Neoverse平台中的应用,加速了基础设施中基于Arm的解决方案的开发和采用。” Moortec首席执行官Stephen Crosher说:“我们正在合作提高Arm在7nm上的下一代计算技术的性能和效率。通过将我们的高精度嵌入式传感结构用于Neoverse N1 SDP的开发,我们使客户能够从机器学习,人工智能和数据分析应用将拥有更高的性能和可靠性。” 关于Moortec Moortec于2005年成立,能够为监控提供引人注目的嵌入式子系统IP解决方案,主要是针对40纳米直至7纳米的高级节点CMOS(互补金属氧化物半导体)技术。Moortec的芯片内传感解决方案支持满足半导体设计领域对提升设备可靠性,以及加强性能优化与改进电源管理控制系统的需求。